Algunos Problemas

Algunos Problemas

de Sofía Boselli Graf -
Número de respuestas: 4

Primero, en la parte del astable cuando variamos el preset se observan cambios en el periodo, al realizar las cuentas suponiendo que la salida no es simetrica, el cálculo del período no depende de la porción de resistencia en cada rama. Podria ser correcto esto? Si no lo esta no sabriamos como justificarlo.

Luego, en la parte del CMRR realizamos varias medidas mientras es valida la suposición que la ganancia diferencial es R3/R1 y los valores son coherentes entre si alrededor de 105 dB. Luego alrededor de 10k Hz (sin la suposición) obtuvimos entre 80 y 90 dB yno sabemos porque exisitiría esta diferencia. Creemos que el problema puede ser la Ad dado que encontramos que satura muy facilmente por lo que tuvimos que poner un voltaje de amplitud de entrada muy pequeño (5-10mV). Esta bien suponer esto?


Gracias!!

En respuesta a Sofía Boselli Graf

Re: Algunos Problemas

de Fernando Silveira -

1) Analizaron el impacto de que las tensiones de saturacion positiva y negativa son diferentes ?

2) 105dB es un poco alto pero podría ser. Es normal que al aumentar la frecuencia el CMRR baje, pero pueden analizar de donde proviene la reducción que estan viendo, fue Ad que bajó? Si si, lo que bajó es esperable de acuerdo a la teoría y el valor del fT del operacional ? O además Ac aumentó (que es esperable) ? Sobre los 105dB pueden tratar de medir Ad a esa frecuencia y confirmar que tienen la ganancia R3/R1 que esperan (que los valores de las Rs que tienen en el circuito están correctos).

Saludos,

Fernando

En respuesta a Sofía Boselli Graf

Re: Algunos Problemas

de Fernando Silveira -
1) Analizaron el impacto de que las tensiones de saturacion positiva y negativa son diferentes ?

2) 105dB es un poco alto pero podría ser. Es normal que al aumentar la frecuencia el CMRR baje, pero pueden analizar de donde proviene la reducción que estan viendo, fue Ad que bajó? Si si, lo que bajó es esperable de acuerdo a la teoría y el valor del fT del operacional ? O además Ac aumentó (que es esperable) ? Sobre los 105dB pueden tratar de medir Ad a esa frecuencia y confirmar que tienen la ganancia R3/R1 que esperan (que los valores de las Rs que tienen en el circuito están correctos).

Saludos,

Fernando


Enviado desde mi smartphone Samsung Galaxy.

-------- Mensaje original --------
De: "Sofía Boselli Graf (vía FING)" <noreply@fing.edu.uy>
Fecha: 12/4/19 19:45 (GMT-03:00)
Para: Fernando Silveira <silveira@fing.edu.uy>
Asunto: ElecFund: Algunos Problemas

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Algunos Problemas
de Sofía Boselli Graf - viernes, 12 de abril de 2019, 19:11
 

Primero, en la parte del astable cuando variamos el preset se observan cambios en el periodo, al realizar las cuentas suponiendo que la salida no es simetrica, el cálculo del período no depende de la porción de resistencia en cada rama. Podria ser correcto esto? Si no lo esta no sabriamos como justificarlo.

Luego, en la parte del CMRR realizamos varias medidas mientras es valida la suposición que la ganancia diferencial es R3/R1 y los valores son coherentes entre si alrededor de 105 dB. Luego alrededor de 10k Hz (sin la suposición) obtuvimos entre 80 y 90 dB yno sabemos porque exisitiría esta diferencia. Creemos que el problema puede ser la Ad dado que encontramos que satura muy facilmente por lo que tuvimos que poner un voltaje de amplitud de entrada muy pequeño (5-10mV). Esta bien suponer esto?


Gracias!!


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Re: Algunos Problemas

de Tania Lorena Aguirre Lordoguin -

Muchas gracias.

(1)a)Sí, realizamos los cálculos de obtención del período suponiendo los voltajes de saturación dados por la simulación. Al realizar dicho cálculo, nuestro período depende de los valores de saturación, resistencias, capacitor, pero NO depende de la porción de resistencia en cada rama. Por lo tanto no podemos explicar la razón por la cual al variar la resistencia variable cambia el período.

b) Al medir el período en el simulador obtuvimos el período entre 1.2ms( dutycycle= 21,12%) a 0.9ms (dutycycle =85,04%) mientras que nuestras medidas en waveform varían entre 1,60ms (80%) a 1,35ms (20%). Lo cual no consideramos correcto.

c) Medimos el SR en la simulación pero al medir en nuestro circuito obtuvimos un valor menor; con esto entendemos que al operacional le lleva más tiempo conmutar, pero... ¿A qué se debe esto?

(2) Muchas gracias!! Observamos que Ac disminuye al aumentar la frecuencia; ¿Cómo sabríamos que esto es correcto? ¿Qué justificación hay para el hecho? ¿Con qué podríamos compararlo?

(3)Analizando todo esto, nos entro la duda que no idealidades considera SPICE, porque notamos que el modelo no considera los 8 pines, los relacionados con el Voffset no están.

Perdona por tantas preguntas

Gracias


En respuesta a Tania Lorena Aguirre Lordoguin

Re: Algunos Problemas

de German Fierro -

Hola Tania,

1) (a) Les sugiero que revisen bien las cuentas, el efecto de la asimetría de los voltages de saturación del operacional rompe bastante la simetría de funcionamiento.

(b) Intenten localizar diferencias entre la simulación y medida, no sólo comparando el período. por ej: diferencias en voltages de saturación, voltages de diodo, diferencias en las porciones de tiempo que comprenden el período, etc . Van a tener bajar un nivel de abstracción en el problema para explicar sus resultados.   

(c) Miren en la hoja de datos si el SR que miden está dentro de los posibles valores que declara el fabricante. Si está muy lejos del "peor SR" declarado, revisen la medida. 

(2): Releven respuesta en frecuencia de ambas transferencias (Adt y Acmt) con cuidado. Por ejemplo, varios puntos por década, precaución que no haya distorsión en la salida en alguna banda de frecuencia, ser criterioso cuando las amplitudes a medir sean muy pequeñas.    

(3) Buscaría encontrar las diferencias analizando más detalladamente los problemas, por ejemplo, tienen todo analizar las diferencias entre la simulación y las medidas, y corroborar con los cálculos; les sugiero que indaguen más críticamente por ahí.     

Saludos,

Germán