Práctica 4

Objetivos

• Tomar contacto con el estándar Wishbone para interfaces entre módulos (IP cores) dentro de un sistema integrado en un chip (System on Chip o SoC). Se usarán transferencias simples de lectura y escritura.

Descripción general del problema

 

El sistema a diseñar permitirá, desde un PC, escribir y leer varios dispositivos esclavo conectados a un bus Wishbone.Para esto se utilizará
un IP Core que recibe comandos a través de la conexión JTAG y los
traduce en ciclos Wishbone.